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AD9434是一種款12位單面采樣系統系統軟件變位系數轉成成器（ADC），對應高特性、低耗電量易和用性參與了推廣策劃方案。該部件事業在將高達500 MSPS的轉成成率，并推廣策劃方案了在移動移動寬帶載波和移動移動寬帶系統軟件的出色動態展示特性。所有應該的模塊，具有采樣系統系統軟件保證和電流電流基準值，都主要包括在電子器件上，以帶來了全面的數據表格信息轉成成避免策劃方案。VREF引腳可于追蹤內部結構選取或帶來了靜態選取電流電流（靜態選取模試需借助SPI接口起用）。ADC應該1.8 V仿真模擬電流電流電和其中一個差分掛鐘以做到全特性實際操作。數字8模擬打出與LVDS（ANSI-644）兼容，扶持二進制補碼、偏斜二進制文件類型或格雷碼。數據表格信息掛鐘模擬打出可于無誤的模擬打出數據表格信息定時任務。

顯著特點信噪比=65 dBFS，率高至250 MHz，率為500 MSPSfIN為10.5位ENOB，非常高為250 MHz，500 MSPS（?1.0 dBFS）在500 MSPS（?1.0 dBFS）幾率下，SFDR=78 dBc，高達250 MHz集成式導入緩沖區器優秀企業的波形度DNL=±0.5 LSB具代表性值INL=±0.6 LSB類型值500 MSPS時的LVDS（ANSI-644檔次）1GHz全輸出模擬仿真傳輸速率片上參看，不用外表解耦低額定功率500 MSPS-LVDS SDR方法下為690 mW660萬千瓦，500 MSPS-LVDS DDR模式英文可java開發（標稱）填寫電阻依據1.18 V p-p至1.6 V p-p，1.5 V p-p標稱值1.8 V養成和自然數電方法可選裝內容輸出數據文件論文格式（移位二進制，兩位補碼，格雷碼）鬧鐘占空比不穩器模塊化動態數據鬧鐘輸出的，中帶可源程序鬧鐘和數據文件兩端對齊

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